Elektrotechnik asic

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Wie viel kostet es, einen kundenspezifischen ASIC herstellen zu lassen?

Ich habe mehrere ASIC-Herstellerwebsites durchsucht, aber keine tatsächliche Nummer gefunden. Ich gehe davon aus, dass mit dem Erstellen von Masken und dergleichen feste Kosten verbunden sind und dass dann Kosten pro Einheit anfallen. Hinweis: Ich bin nur neugierig, dass ich eigentlich keinen ASIC machen lassen möchte.

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Inwiefern unterscheidet sich das ASIC-Design von der FPGA-HDL-Synthese?

Ich habe einige Erfahrungen mit FPGA / HDL-Tool-Suites wie Xilinx ISE, Lattice Diamond usw. gesammelt. Der allgemeine Workflow besteht darin, Verilog / VHDL zu schreiben, zu simulieren, zu testen und dann das FPGA zu programmieren. Ich habe ein paar Leute sagen hören, dass das ASIC-Design sehr unterschiedlich ist. Welche Toolsets …

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Was sind die Unterschiede und Gemeinsamkeiten zwischen FPGA, ASIC und General Microcontrollern?

Ich habe diesen Beitrag gelesen und er beantwortet meine Frage nicht vollständig: Ich stelle mir einen Mikrocontroller vor, der über Speicher verfügt, sich registriert und Befehle wie LOAD, STORE und ADD verarbeiten kann. Es enthält logische Gatter und dergleichen, um seine Rolle zu erfüllen, aber seine Hauptaufgabe ist es, ein …

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Was sind die praktischen Anwendungen von ASIC?

Mikrocontroller, FPGAs, ASIC (Application Specific Integrated Circuit) werden alle für ähnliche Arten von Anwendungen (auf verschiedenen Ebenen) verwendet. Ich kenne mich mit Mikrocontrollern und FPGAs aus. Aber was ist eigentlich ein ASIC? Es fällt mir schwer zu verstehen, warum wir all diese sehr ähnlichen Technologien haben.

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Zurücksetzen: synchron vs. asynchron

Ich habe jahrelang mit fpgas gearbeitet und immer synchrone Resets für alle Teile (die es brauchen) meiner Schaltkreise verwendet. Es hilft der Schaltung, bei einem gegebenen Taktzyklus global zurückgesetzt zu werden. Mir wurde jedoch gesagt, dass in ASIC-Schaltkreisen die Leute dazu neigen, überall asynchrones Zurücksetzen zu verwenden. Ich frage mich, …

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Was sind weiche, feste und harte IP-Kerne? [geschlossen]

Geschlossen . Diese Frage muss gezielter gestellt werden . Derzeit werden keine Antworten akzeptiert. Möchten Sie diese Frage verbessern? Aktualisieren Sie die Frage so, dass sie sich nur auf ein Problem konzentriert, indem Sie diesen Beitrag bearbeiten . Geschlossen vor 2 Jahren . Ich verstehe unter IP-Kernen (Intellectual Property), dass …

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Können Sie einen passiven ASIC bekommen?

In superkleinen Geräten mit geringem Stromverbrauch, bei denen der Platzbedarf eine große Rolle spielt, können komplizierte passive Netzwerke viel Platz beanspruchen. Ist es möglich, einen passiven oder größtenteils passiven ASIC herzustellen? Wenn es möglich ist, wie viel würde es kosten? Natürlich würde es sich niemals den winzigen Kosten diskreter Passive …

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Wie erfolgt die Programmausführung in der Firmware?

Ich habe von Leuten gehört, die in der Firmware-Domäne arbeiten, dass es kein Betriebssystem gibt, das die Firmware steuert (z. B. Firmware in einem USB-Laufwerk). In einer while-Schleife läuft nur ein einziger Thread, der auf einen externen Befehl wartet. Dies ist der Startpunkt für einen Interrupt, gefolgt von einem ISR …

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Warum können Verzögerungen in Verilog nicht synthetisiert werden?

Ich habe immer gelesen, dass im RTL-Code deklarierte Verzögerungen niemals synthetisiert werden können. Sie sind nur für Simulationszwecke gedacht und moderne Synthesewerkzeuge ignorieren Verzögerungsdeklarationen im Code. Zum Beispiel: x = #10 y;wird als betrachtetx = y; vom Synthesewerkzeug . Was sind die Gründe, warum Verzögerungsdeklarationen in einer Hardwarebeschreibungssprache (z. B. …

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Exotische Halbleiter für schnellen digitalen ASIC

Ich erforsche exotische Halbleiter für einen digitalen ASIC mit einigen Millionen Logikgattern, die mit einem Budget von 30 Millionen US-Dollar so schnell wie möglich laufen sollten. (Insbesondere muss ich eine einzelne vollständig parallele 4096-Bit-Multiplikation wiederholt durchführen. Für mehr Kontext erstelle ich einen ASIC, um diese überprüfbare Verzögerungsfunktion zu berechnen .) …

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Was kann schief gehen, wenn ein ASIC aus einem FPGA-verifizierten Verilog-Design erstellt wird?

Wie hoch sind die Chancen, dass ein Dienst wie CMP angesichts eines Verilog-Designs, das auf einem FPGA-Prototyping-System vollständig validiert wurde, und einer Person, die noch nie zuvor einen ASIC durchgeführt hat, beim ersten Versuch vollständig verwendbare Chips ausliefert? Soweit ich das beurteilen kann, stellen sie die Zellbibliothek und die Tools …

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ASIC-Verfeinerung Muss ich alle möglichen Kombinationen überprüfen?

Ich mache derzeit eine ASIC Black Box-Überprüfung. Angenommen, ich habe ein Modul mit 200 Eingangsports mit jeweils 12 Bit Breite und einen Ausgangsport mit 64 Bit Breite. Sagen wir, es ist rein kombinatorisch im Inneren. [11:0] +------------+ inputport 0 ------/------> | | . -------------> | | [63:0] . -------------> | …

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