Elektrotechnik vhdl

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VHDL und Verilog sind die HDLs des Tages. Was sind die Vorteile für jemanden, der überhaupt keine Erfahrung mit HDLs hat?

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Inwiefern unterscheidet sich das ASIC-Design von der FPGA-HDL-Synthese?

Ich habe einige Erfahrungen mit FPGA / HDL-Tool-Suites wie Xilinx ISE, Lattice Diamond usw. gesammelt. Der allgemeine Workflow besteht darin, Verilog / VHDL zu schreiben, zu simulieren, zu testen und dann das FPGA zu programmieren. Ich habe ein paar Leute sagen hören, dass das ASIC-Design sehr unterschiedlich ist. Welche Toolsets …

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Lesbare und lehrreiche Implementierungen einer CPU in einer HDL

Können Sie eine lesbare und lehrreiche Implementierung einer CPU in VHDL oder Verilog empfehlen? Am liebsten etwas gut dokumentiertes. PS Ich weiß opencores, dass ich es mir ansehen kann , aber ich interessiere mich speziell für Dinge, die die Leute tatsächlich angeschaut und interessant gefunden haben. PS2. Tut mir leid, …

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Kostenlose IDE für VHDL und Verilog [geschlossen]

Ich interessiere mich für das Lernen von VHDL und Verilog. Ich habe mich gefragt, ob es eine kostenlose IDE für diese gibt.

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VHDL: Konvertieren von einem INTEGER-Typ in einen STD_LOGIC_VECTOR

Ich habe einen Mod-16-Zähler gebaut und das Ergebnis ist ein INTEGER (in allen Beispielen wurde INTEGER verwendet). Ich habe einen Hex-zu-7-Segment-Display-Decoder gebaut, und sein Eingang ist ein STD_LOGIC_VECTOR (schrieb es so, weil es einfach war, die Wahrheitstabelle abzubilden). Ich möchte den Ausgang des Zählers mit dem Eingang des Decoders verbinden, …

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Günstigstes FPGA-Entwicklungskit zum Erlernen der VHDL- und FPGA-Theorie?

Ich suche etwas, mit dem ich herumspielen kann, für das ich aber nicht zu viel ausgeben darf. Ich habe keinen Anspruch auf einen akademischen Rabatt. Berücksichtigen Sie dies, wenn Sie Vorschläge machen.

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VHDL: Component vs Entity

Ich frage mich, was der Unterschied zwischen einer Komponente und einer Entität ist. Ich würde gerne wissen, in welchen Fällen es besser ist, Komponenten anstelle von Entitäten zu verwenden. Ich danke dir sehr.

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VHDL-Interviewfrage - Ermitteln, ob eine Zahl ohne Rest durch 5 geteilt werden kann

Ich habe eine nette Interviewfrage für VHDL gesehen - baue ein System, das eine Nummer erhält und erkennt, ob es ohne Rest durch 5 geteilt werden kann. Ich habe versucht, das mit einer Zustandsmaschine zu lösen (ich nehme an, sie möchten nicht, dass Sie Mod oder Rem verwenden ), und …

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std_logic oder std_ulogic?

Es scheint, dass die Welt entschieden hat, dass std_logic(und std_logic_vector) die Standardmethode für die Darstellung von Bits in VHDL sind. Die Alternative wäre std_ulogic, die nicht gelöst wird. Das überrascht mich , weil in der Regel, sind Sie nicht eine Beschreibung von Bus , so dass Sie tun Sie nicht …

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Wie lerne ich HDL?

Ich habe einen Kurs in Digital Design in diesem Semester und liebe es einfach. Jetzt weiß ich, dass der Großteil der Arbeit im Bereich Embedded System und Digital Design zunächst auf Computersimulatoren erledigt und dann mithilfe von Hardware implementiert wird. Also habe ich mich gefragt, wie ich HDL lernen soll. …

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VHDL, die das FPGA beschädigen kann

Ich habe irgendwo gelesen, dass schlechter VHDL-Code zu FPGA-Schäden führen kann. Ist es überhaupt möglich, ein FPGA mit VHDL-Code zu beschädigen? Welche Bedingungen würden dies verursachen und was sind die Worst-Case-Szenarien?

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VHDL IDE für eine GNU / Linux-Umgebung

Ich muss VHDL von 0 lernen und ich möchte eine Option haben, die unter einem Linux-Kernel anstelle von NT / Windows läuft: irgendwelche Tipps? Ich kann auch einige gute Links zu guten VHDL-Ressourcen für Anfänger wirklich schätzen, danke.

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Soft-CPU-Überprüfung

Ich bin gerade dabei, eine einfache CPU in VHDL mit Xilinx ISE und ISIM zu entwerfen. Der Designteil läuft bemerkenswert gut, aber ich kann anscheinend keine Möglichkeit finden, die Überprüfung auf konsistente Weise durchzuführen. Im Moment habe ich einen VHDL-Prüfstand, den ich aktualisiere, um die Funktion zu testen, an der …

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Gibt es native Mac OS X-Umgebungen für den Einstieg in VHDL / FPGAs?

Der Titel bringt meine Frage auf den Punkt: Gibt es native Mac OS X-Umgebungen für den Einstieg in VHDL / FPGAs?

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VHDL: ganze Zahlen für die Synthese?

Ich bin ein bisschen verwirrt, ob ich in VHDL ganze Zahlen für Synthesesignale und Ports usw. verwenden soll. Ich benutze std_logic auf höchster Ebene Ports, aber intern ich wurde überall lagen ganze Zahlen verwenden. Ich bin jedoch auf einige Verweise auf Personen gestoßen, die sagten, Sie sollten nur signierten / …

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