Elektrotechnik fpga

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Ich möchte eine Phasenverriegelung in einem FPGA implementieren, ohne externe Komponenten (außer dem ADC) zu verwenden. Der Einfachheit halber ist das Sperren auf einen einfachen Binärimpuls ausreichend. Die Frequenz der Signale beträgt ~ 0,1-1% des Takts. Ich kann die integrierten Uhr-PLLs nicht verwenden, da sie normalerweise: Nicht konfigurierbar (während der …

9 fpga dsp pll

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Welche Methode schlagen Sie für das Prototyping asynchroner Schaltungen vor?

Ich war überrascht und bis zu einem gewissen Grad schockiert, als ich feststellte, dass es kein etabliertes Werkzeug zum Entwerfen und Prototypen von asynchronen Schaltungen gibt. Ich suche weiterhin mit Google und anderen Mitteln, um eine gute Methode zum Entwerfen von asynchronen VLSI-Schaltkreisen zu finden, aber bisher haben die Suchanfragen …

9 fpga vlsi eda

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So erhalten Sie ein FPGA-Design, das auf jeden Fall auf der tatsächlichen Hardware funktioniert

Ich habe gerade angefangen, digitales Logikdesign mit FPGAs zu lernen, und habe viele Projekte erstellt. Meistens (da ich eine Art Noob bin) habe ich ein Design, das perfekt simuliert (Verhaltenssimulation), aber nicht richtig synthetisiert. Meine Frage lautet also: "Welche Entwurfsschritte kann ich in meinen Workflow integrieren, um sicherzustellen, dass ich …

9 digital-logic fpga design xilinx synthesis

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benutzerdefinierte FPGA PCB Design-Tipps

Ich plane, eine benutzerdefinierte FPGA-Platine zu entwerfen. Die Platine enthält Sensoren. Ich muss die Ausgabe der Sensoren lesen und sie im Prozessor verarbeiten. Ich habe viele Projekte mit FPGAs abgeschlossen, aber dies wird mein erstes benutzerdefiniertes Design sein, bei dem ich auch die Hardwarekonfiguration berücksichtigen muss. Ich habe in letzter …

9 pcb fpga design

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Simulation des FPGA-Designs ohne die eigentliche Hardware

Ich bin neu im FPGA und nehme derzeit an der HDL-Klasse (insbesondere Verilog) teil. Ich habe ausreichende Kenntnisse im digitalen Design wie kombinatorischen und sequentiellen Schaltungen. Ich möchte ein Projekt erstellen, das dem in diesem YouTube-Video gezeigten ähnelt . Ich weiß auch, dass Xilinx ISE Logiksignale verarbeiten und Wellenformen simulieren …

9 fpga hdl

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Wann wäre AXI4Lite die bessere Wahl als der APB-Bus?

Ich arbeite daran, ein bereits funktionsfähiges großes FPGA-Design mit einem 64-Bit-Datenbus zu verbessern und zu bereinigen. Eine der aufgeworfenen Fragen ist: "Sollten wir alle unsere Busse auf AXI4Lite / APB umstellen oder sollten wir sie so lassen, wie sie sind?" Einige sind AXI4Lite und einige sind APB. Die Mitarbeiter des …

8 fpga vhdl interface hardware bus

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Was sind die typischen Verwendungszwecke für einen Softprozessor wie MicroBlaze?

Ich weiß, dass die FPGA-DSP-Kombination normalerweise für High-End-Leistungselektronik / Ultraschall / MRT / etc. Verwendet wird. Kann der Softprozessor den DSP auch bei FPGAs der unteren Preisklasse wie Spartan 3/6 vollständig ersetzen? Hinzugefügt: Was wäre der Grund für mehrere Softcore-Prozessoren in einem FPGA?

8 fpga processor microblaze softcore

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wie man eine architektur in einem fpga ic für immer richtig speichert

In Anbetracht dessen, dass ich eine Architektur erstellt habe, um eine bestimmte Sache zu tun, schrieb ich zum Beispiel in vhdl. Kann ich es für immer in einem FPGA-Chip "brennen"? Oder wie soll ich vorgehen, um das geistige Eigentum zu schützen und zu wissen, dass es aus dem seriellen Flash-Speicher …

8 fpga

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Erkennen Sie Register, die nicht zurückgesetzt werden

Beim Schreiben von Verilog verwende ich verschiedene "Linters", die Fehler und Warnungen ausgeben. Dies sind mein Simulator (ModelSim), mein Compiler (Quartus II) sowie ein Linter (Verilator). Zusammen habe ich eine gute Abdeckung für häufige Fallstricke, wie z. B. Fehlanpassungen der Busgröße und abgeleitete Latches. Leider erkennt keines der drei Tools …

8 fpga verilog

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FPGA Logic Gate Count

Ich habe ein FPGA-Board gefunden, das mir gefallen hat. Es wird ein Xilinx Spartan 6 LX45 verwendet. Als ich zum Datenblatt für die Spartan 6-Serie ging , hieß es nur, dass es 43.661 Logikzellen gab. Wie viele Tore entspricht das? Oder wie würde ich die Anzahl der Gesamtgatter aus der …

8 digital-logic fpga xilinx spartan

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Wie schnell wird eine 64-Bit-Multiplikation oder -Division auf einem FPGA ausgeführt?

Wie viele Zyklen benötigt eine 64-Bit-Gleitkomma-Multiplikation oder -Division mit doppelter Genauigkeit, wenn ein reguläres FPGA wie Xilinx Spartan 3 oder Virtex 5 verwendet wird? Soweit ich weiß, verfügt das FPGA nicht über eine feste FPU, und Sie müssen eine mit den Standard-IEEE-Bibliotheken oder anderen Materialien erstellen. Dies bedeutet, dass es …

8 fpga xilinx math spartan floating-point

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Vergleichen Sie die Implementierung eines einfachen Automatisierungsdesigns auf einer MCU mit einer FPGA / CPLD

Ich arbeite seit den 90er Jahren mit MCUs und habe mich kürzlich mit den Chips der Spartan6-Serie von Xilinx in die FPGA-Szene gewagt. Unter der Annahme eines einfachen Fabrikautomationsdesigns mit Sensoren und Motoren und einiger Intelligenz, um alles miteinander zu verbinden, auf welchem Gerätetyp könnte ich das Design schneller und …

8 microcontroller fpga xilinx development spartan

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Wie treffen kommerzielle Mikroprozessoren das Timing mit einer Gigahertz-Uhr?

Ich habe Probleme damit, dass ein relativ einfaches FPGA-Design (für einen Altera Cyclone IV) das Timing für die von einem 250-MHz-Takt gesteuerte Logik erfüllt. Ich frage mich daher, wie es kommerziellen Mikroprozessoren (wie dem Intel Core i7) gelingt, das Timing bei Taktfrequenzen zu erreichen, die um eine Größenordnung höher sind. …

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Verwendung des HDMI-Anschlusses am FPGA (Basic)

Zwei Fragen. Ich habe ein Xilinx Spartan 6 FPGA, das nur HDMI-Ein- und Ausgänge hat. Gibt es eine Anleitung oder einen vorab geschriebenen Code, mit dem ich Bilder an den Bildschirm senden kann? Ich habe keine Ahnung, wie ich anfangen soll, und ich konnte keine Ressourcen finden. Zweitens, der Grund, …

8 fpga adapter vga hdmi

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FPGA VGA Puffer. Wie lese und schreibe ich?

Ich habe ein Altera DE2-Board und versuche, Sprites zu zeichnen. Ich habe Probleme beim Implementieren eines Bildschirmpuffers. Ich habe eine Anzeigeeinheit, die mit einer Rate von 25 MHz Pixel für die VGA-Anzeige ausgibt. Ich hatte gehofft, einen Puffer in SDRAM zu implementieren. Die ursprüngliche Idee war, Pixel das nächste Pixel …

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Als «fpga» getaggte Fragen