Als «pll» getaggte Fragen

PLL ist die Abkürzung für "Phase Locked Loop". Eine PLL ist eine Schaltung, die einen lokalen (spannungsgesteuerten) Oszillator mit einer unabhängigen gegebenen Signalfrequenz synchronisieren kann.

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Was ist der Unterschied zwischen einer PLL und einer DLL?
Phasenregelkreise (PLLs) und Verzögerungsregelkreise (DLLs) werden in verschiedenen Anwendungen verwendet, aber es gibt noch keine ausführliche Diskussion der wichtigsten Aspekte dieser Schaltungen, wie sie funktionieren, in welchen Anwendungen sie verwendet werden könnten, sowie des Vergleichs zwischen diesen die zwei Stromkreise und warum sollte man gegen den anderen verwendet werden.
25 pll  dll 

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PLL - warum Phasen nicht Frequenzen vergleichen
Ich habe eine Frage zu PLLs. Das Ziel der PLL ist es, zwei Signale mit den gleichen Frequenzen zu erhalten (soweit ich weiß, kann es zu Phasenverschiebungen kommen). Warum verwenden Sie in diesem Fall einen Phasendetektor, um Phasen zu vergleichen, und NICHT nur, um Frequenzen zu vergleichen? Danke
17 pll 


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Wie steuern Prozessoren ihre Taktrate?
Vor kurzem bin ich auf einen STM-Prozessor mit zwei Oszillatoren gestoßen - einen für Hochgeschwindigkeitsbetrieb und einen für geringen Stromverbrauch. Für so etwas wie einen Desktop-Prozessor, bei dem die Taktrate (innerhalb eines bestimmten Rahmens) auf eine beliebige Frequenz eingestellt werden kann - wie funktioniert das physikalisch ?



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Alle digitalen Phasenregelkreise
Ich möchte eine Phasenverriegelung in einem FPGA implementieren, ohne externe Komponenten (außer dem ADC) zu verwenden. Der Einfachheit halber ist das Sperren auf einen einfachen Binärimpuls ausreichend. Die Frequenz der Signale beträgt ~ 0,1-1% des Takts. Ich kann die integrierten Uhr-PLLs nicht verwenden, da sie normalerweise: Nicht konfigurierbar (während der …
9 fpga  dsp  pll 

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Wie fahre ich einen 14,3-MHz-Takteingang von 10 MHz?
Ich beabsichtige, einen IC zu verwenden, der einen 14,3-MHz-Takteingang benötigt, möchte ihn jedoch von einer stabilen 10-MHz-Quelle aus steuern - abgeleitet von GPS. Wie verwandle ich den 10-MHz-Takt in den 14,3-MHz-Takt, den der IC benötigt?
8 clock  pll 

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Wie funktioniert eine PLL in einem FPGA?
Ich habe Altera-FPGAs aus dem letzten Jahr verwendet und möchte wissen, wie die darin enthaltenen PLLs funktionieren. Haben Sie wirklich irgendeine analoge Schaltung im Inneren, um den Phasenversatz zwischen VCO und externem Signal zu messen? Diese hübschen Stücke sind über einen weiten Frequenzbereich (derzeit 100 MHz und darüber hinaus sogar …
8 fpga  pll 


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Was ist eine Jaffe-Rechtin PLL?
Eberhardt Rechtin und Richard Jaffe (beide an der DSN der NASA beteiligt) haben dieses Papier (Paywalled) über PLL-Design und -Leistung bereits 1955 veröffentlicht. Es wird häufig darauf verwiesen, daher wollte ich verstehen, was eine "Jaffe-Rechtin" -Schleife ausmacht oder -Filter. Ich hätte nach so langer Zeit einen Wiki-Artikel über ein scheinbar …



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3 Hz von einem Uhrenkristall
Ich habe einen Schrittmotor mit einem Schrittwinkel von 2 Grad. Ich möchte Sekunden mit einer an diesem Stepper befestigten Nadel anzeigen. Der Uhrenkristall teilt sich gut, um 1-Hz-Impulse zu erzeugen, sodass ich dem Stepper jede Sekunde befehlen kann, CW-3-Impulse zu drehen (360 Grad / 60 Sekunden = 6 Grad pro …
7 msp430  crystal  pll 
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