SDRAM steht für synchronen dynamischen Direktzugriffsspeicher. Da es synchron ist, ist es auf ein separates Taktsignal angewiesen, um Befehle und Daten zum / vom Gerät zu verschieben.
Für ein Projekt, das ich entwerfe, verwende ich einen IS42s32800 (TSOP) SDRAM mit einem LPC1788 (QFP) Mikrocontroller. Auf der Platine habe ich 4 Schichten mit einer Masseebene direkt unter der oberen Signalschicht und einer VDD-Ebene direkt über der unteren Signalschicht. Durchschnittliche Leiterbahnen zwischen der CPU und dem RAM sind 60 …
Wenn ein 32- Bit-Prozessor ungefähr 4 GiB RAM (dh 232=4294967296232=42949672962^{32} = 4 294 967 296 ) Bytes verarbeiten kann, warum verfügt mein Arduino Mega 2560 über 8 KiB SRAM, wenn er als 8- Bit-Prozessor nur 256 Bytes verarbeiten kann Bytes ( 28282^8 )? Oder lese ich die folgende Seite falsch? …
Ich habe ein Design mit einem LPC1788 zusammen mit einem SDRAM-Modul von ISSI ( IS42S32800D ). Dies ist eine 32-Bit-Schnittstelle. Ich habe dieses Design ausgearbeitet und einen Prototyp mit einem Leiterplattenhersteller herstellen lassen, der 6-Schicht-Prototypen herstellt. Der Prototyp der Leiterplatte funktioniert einwandfrei. Ich dachte dann, ich würde die Leiterplatte in …
Ich arbeite an einem Projekt mit dem ziemlich neuen STM32F429 im LQFP208-Paket. Ich muss die ersten Prototypen aus Gründen des geringen Budgets selbst löten. Ich wähle dieses Paket, um selbst zu überprüfen, ob ein Problem auf das Routing / die Firmware oder nur auf ein Lötproblem zurückzuführen ist. Im Projekt …
Ich versuche, eine vorhandene Init-Sequenz (Low-Level-Init des SDRAM) zu ändern, um einer Änderung der Hardwarekonfiguration Rechnung zu tragen: Ein vorhandenes SDRAM auf meinem iMX31 wurde durch eine andere Größe ersetzt, ansonsten derselbe Typ / Hersteller / Layout / Pins / Timings. . nach Angaben. Kurzes Setup-Szenario und Fehlerverhalten: Ich habe …
Die Festplatte arbeitet teilweise sequentiell. RAM ist jedoch für den zufälligen Speicherzugriff bekannt und ermöglicht zu jedem Zeitpunkt die gleiche Geschwindigkeit des Speicherzugriffs für jeden Standort. Was macht RAM so besonders? Wie funktioniert der zufällige Speicherzugriff? (Ich weiß, dass DRAM nicht gerade Direktzugriff ist und im Burst arbeitet. Ich bin …
Ich kenne den Coldboot-Trick schon eine Weile, habe aber die Physik dahinter nie wirklich in Betracht gezogen. Ich habe die Zeitung gelesen , aber sie behandelt nicht wirklich, warum sie funktioniert. Wie bewirkt die physische Abkühlung eines RAM-Sticks auf eine sehr niedrige Temperatur, dass die darin gespeicherten Daten auch ohne …
Ich beschreibe ein System in VHDL. Dieses System enthält bereits einen Prozessor, einen DDR-SDRAM-Controller und einen VGA-Controller. VGA liest Pixel aus dem SDRAM (bereits validiert und im FPGA bewährt). Obwohl VGA und SDRAM bereits miteinander kommunizieren, muss die Verbindung zwischen Prozessor und SDRAM noch implementiert werden. Am Ende möchte ich …
Dieser Begriff wird im Micron Application Note: Hardwaretipps für das Punkt-zu-Punkt-Systemdesign auf Seite 10 erwähnt (... für Signale mit Einführungsabschluss ...), aber ich habe mich bemüht, genau herauszufinden, was Einführungsbeendigungsmittel. Es ist ein ziemlich schwieriger Google-Suchbegriff: Ich habe auf dieser letzten Seite endlich einen Verweis auf "Lead-In vs. Loaded Routing" …
Ich beginne mit der VHDL-Codierung und habe einige grundlegende Bildverarbeitungen auf meinem Entwicklungsboard durchgeführt. Ich habe festgestellt, dass die meisten FPGA-Entwicklungskarten häufig DRAM (SDRAM, DDRAM) als RAM verwenden. Zum Beispiel verwende ich eine FPGA-Entwicklungskarte von TERASIC und sie verwendet DRAM. Obwohl der DRAM-Speicher billiger zu sein scheint als der SRAM …
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